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国家自然科学基金(60676016)

作品数:16 被引量:378H指数:6
相关作者:姚丽娜胡建国曾献君冀蓉陈亮更多>>
相关机构:国防科学技术大学湖南广播电视大学中南大学更多>>
发文基金:国家自然科学基金湖南省高等学校科学研究项目东莞市科研发展专项基金更多>>
相关领域:自动化与计算机技术电子电信机械工程一般工业技术更多>>

文献类型

  • 16篇中文期刊文章

领域

  • 8篇自动化与计算...
  • 7篇电子电信
  • 2篇机械工程
  • 1篇一般工业技术

主题

  • 6篇电路
  • 5篇时钟
  • 2篇电路设计
  • 2篇信号
  • 2篇信号完整性
  • 2篇硬件
  • 2篇时钟抖动
  • 2篇时钟偏斜
  • 2篇微处理器
  • 2篇相位
  • 2篇ANDROI...
  • 2篇J2ME
  • 2篇处理器
  • 1篇低功耗
  • 1篇电路仿真
  • 1篇电路设计与实...
  • 1篇多层板
  • 1篇延迟锁定环
  • 1篇延迟锁相环
  • 1篇引擎

机构

  • 9篇国防科学技术...
  • 7篇湖南广播电视...
  • 2篇中南大学
  • 2篇西安卫星测控...
  • 1篇福州大学
  • 1篇东莞理工学院
  • 1篇中山大学

作者

  • 5篇曾献君
  • 5篇姚丽娜
  • 5篇胡建国
  • 4篇陈亮
  • 4篇冀蓉
  • 2篇刘烨铭
  • 2篇曹跃胜
  • 2篇张峻峰
  • 2篇罗钢
  • 2篇姚昱旻
  • 2篇刘卫国
  • 2篇夏笠芹
  • 1篇位召勤
  • 1篇何小威
  • 1篇李承志
  • 1篇胡军
  • 1篇胡思思
  • 1篇冯颖劼
  • 1篇李少青
  • 1篇袁扬智

传媒

  • 3篇微电子学
  • 2篇电子学报
  • 2篇计算机工程与...
  • 2篇微电子学与计...
  • 2篇计算机系统应...
  • 1篇Journa...
  • 1篇制造业自动化
  • 1篇通信技术
  • 1篇计算机工程与...
  • 1篇微计算机信息

年份

  • 2篇2011
  • 4篇2009
  • 9篇2008
  • 1篇2007
16 条 记 录,以下是 1-10
排序方式:
超大规模集成电路的时钟偏斜及其补偿技术被引量:1
2011年
微处理器急剧增长的性能要求对时钟分布网络设计提出了严峻的挑战,45nm以下的后纳米电路阶段,时钟偏移调整、片内外时钟相位的同步、低功耗时钟分布网络设计是高速时钟分布网络设计面临的关键问题。本文介绍了有关时钟偏斜的背景知识,总结了近年来微处理器时钟偏斜补偿技术的最新进展,并对其可能的发展方向进行了展望。
罗钢曾献君
关键词:时钟树时钟偏斜
A 5 Gb/s transceiver in 0.13μm CMOS for PCIE2.0
2011年
This paper presents a CML transceiver for a PCI-express generation 2 physical layer protocol that has been fabricated by SMIC's 0.13μm CMOS technology.The active area of the transceiver is 0.016 mm^2 and it consumes a total of 150 mW power at a 1.2 V supply voltage.The transmitter uses two stage pre-emphasis circuits with active inductors,reducing inter-symbol interference and extended bandwidth;the receiver uses a time-domain adaptive equalizer,the circuit uses an inductive peaking technique and extends the bandwidth,and the use of active inductors reduces the circuit area and power consumption effectively.The measurement results show that this circuit could stably transmit the signal at the data rate of 5 Gbps,the output signal swing of the transmitter is 350 mV with jitter of 14 ps,the eye opening of the receiver is 135 mV and the eye width is 0.56 UI.The circuit performance sufficiently meets the requirements of the PCI-Express 2.0 protocol.
罗钢高常平曾献君
关键词:CMLPRE-EMPHASIS
基于相位合成的时钟50%占空比调节电路设计被引量:2
2007年
本文介绍了采用纯数字相位合成法设计的高性能时钟50%占空比调节电路PB-DCC(Phase-Blending Du-ty-Cycle Corrector).相比于传统的占空比调节方式,此电路通过采用SMD(Synchronous Mirror Delay)技术具有较强的抗PVT(Process,Voltage and Temperature)变化的能力,输出时钟和原时钟完全同步和较快的调节速度等特点.经0.13μmCMOS工艺版图实现后HSPICE模拟表明,该占空比调节电路对占空比在10%-90%范围内的400MHz时钟能在4个周期内完成调节,输出时钟占空比为48%-52%.
何小威陈亮冀蓉李少青曾献君
关键词:相位合成PVTHSPICE模拟
Android的架构与应用开发研究被引量:309
2008年
首先简要介绍了新一代智能手机平台——Android的系统架构,然后通过和现有智能手机开发平台进行比较研究分析了该平台的结构特点,最后通过在该平台上开发一个在线RSS阅读器验证了该平台的可用性。
姚昱旻刘卫国
关键词:ANDROID智能手机平台J2MERSS阅读器XML
2D图像硬件加速引擎的设计优化被引量:6
2009年
针对便携式设备中图形用户界面图像显示需求的不断提高,分析讨论了2D图像加速引擎的实现技术,基于GBA(Game Boy Advance)的模拟器VBA(Visual Boy Advance)的绘图方法提出了2D图像硬件加速引擎的实现架构,该架构对速度、面积及总线带宽等因素进行了优化处理,减轻了CPU的负荷、同时达到了低功耗设计的目的.基于该架构实现的2D图像硬件加速引擎通过了正确的验证与测试,能有效地支持GBA等2D游戏,根据需要可以应用到不同的图形用户界面,提供高效的图像加速显示能力.
袁扬智韦明曾献君
关键词:GBA游戏低功耗
时钟偏斜补偿电路设计与实现
2008年
时钟系统的稳定性直接决定了在不同操作环境下时钟偏斜值的大小,并影响芯片的可靠性,因此讨论了时钟偏斜补偿电路的设计与实现技术,为提高时钟系统的稳定性并提高在不同操作条件下的可靠性,从电路设计、版图实现的角度采取了有效措施,有效提高了芯片的可靠性。
曾献君陈亮冀蓉胡建国
高速SERDES的多板传输技术与SI仿真被引量:13
2008年
随着SERDES传输速率达到10Gbps,高速PCB上的信号传输尤其是多板间传输,已经成为高速设计的实现难点。高速PCB及其要素的设计、分析、仿真,以及高速传输链路的设计优化,是多板SERDES传输实现更高速率的关键。本文对高速串行SERDES的原理和架构进行了深入分析,研究了多板传输中影响信号完整性(SI)的关键因素和建模优化方法;最后,针对实验电路板建立了多板仿真模型,对实际的SERDES差分网络进行了仿真分析。
曹跃胜胡军刘烨铭
关键词:特性阻抗信号完整性高速串行传输IBISSPICE电路仿真
无源RFID标签天线接口电路研究与实现被引量:12
2008年
电子标签天线接口是芯片获得能量、时序、数据的接口,其设计的好坏直接影响到电子标签的性能。本文探讨了无源RFID电子标签的天线理论和天线耦合接口的功率传输,提出了电子标签天线接口的优化设计和实现电路,进行了仿真验证,并成功应用到标签芯片设计中,已在SMIC0.35μmCMOS工艺下投片成功。
张忠志胡建国位召勤黄丹姚丽娜
关键词:RFID天线天线耦合射频电路
基于FPGA的网络流量计设计与实现被引量:1
2009年
网络测量是研究网络行为和网络流量特性的有效方法。网络计费变得越来越重要,基于流量的网络计费将成为下一代网络计费的模式。文章探讨了网络流量计量的相关技术,阐述了流量计量的重要性,提出了网络流量计量的实现算法和基于FPGA的设计。
胡匡生李承志胡建国姚丽娜夏笠芹胡思思
关键词:网络流量计FPGA
高速多层板过孔分析与仿真被引量:14
2008年
过孔效应已经成为制约高速PCB设计的关键因素之一,介绍了高速PCB设计中过孔对信号完整性的影响,尤其对于高速多层板过孔的特性进行了详细分析,并采用软件对多层印刷电路板上的过孔模型进行了仿真,着重分析了Stub对过孔传输特性所产生的影响,以及Back-drilling工艺的优势,仿真结果对高速PCB设计具有实际指导作用。
刘烨铭曹跃胜
关键词:过孔信号完整性
共2页<12>
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