单书畅
- 作品数：11 被引量：5H指数：1
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- 相关领域：自动化与计算机技术文化科学更多>>
- 基于数据预取的多核处理器末级缓存优化方法被引量：4
- 2012年
- 末级缓存的性能已成为影响多核处理器整体性能的关键因素.基于多核处理器在处理并行程序时各处理器核访存行为的相似性,提出一种降低访存缺失率的数据预取方法.首先记录各处理器核的访存缺失历史;然后通过分析历史信息预测各处理器核之间末级缓存缺失的关联关系,采用数据预取的方式,在处理器核出现读缺失之前为其末级缓存提供数据块.实验结果表明,对于4核和16核处理器系统,该方法可以分别降低末级缓存缺失率9.8%和18.4%,提高性能4.0%与12.4%.
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- 关键词：多核处理器数据预取
- 面向内存的混合容错编码动态调节设计被引量：1
- 2014年
- 针对内存系统中高强度的容错编码容易造成过大开销的问题,为同时实现容错强度和容错开销的权衡,提出一种低开销的支持混合容错编码的动态调节设计.通过分析发现常见纠错检错编码数据位长与校验位长存在固定的比例关系,提出一种地址映射逻辑电路;当系统存取内存数据及容错强度发生调节时,该方法可保证容错编码中校验信息的存取,实现对内存容错强度调节以及数据与校验信息在内存中分开存储的支持.实验结果表明,文中设计简单,硬件和性能代价小、功耗开销低.
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- 关键词：内存系统可靠性容错设计
- 基于数据预取的多核处理器末级缓存优化方法
- 末级缓存的性能已成为影响多核处理器整体性能的关键因素.基于多核处理器在处理并行程序时各处理器核访存行为的相似性，提出一种降低访存缺失率的数据预取方法.首先记录各处理器核的访存缺失历史；然后通过分析历史信息预测各处理器...
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- 关键词：多核处理器数据预取
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- 一种数据存储方法及装置
- 本发明实施例公开了一种数据存储方法及装置，涉及计算机领域，实现了容错编码强度的动态调节。具体方案为：根据数据簇的容错能力和/或数据簇的工作场景选取容错编码类型；其中，数据簇是指受同一容错强度的容错编码保护的数据集合；根据...
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- 文献传递
- 一种相变存储器写加速方法及其系统
- 本发明公开了一种相变存储器写加速方法，该方法包括：Partial-SET写操作判断步骤和写请求执行步骤，Partial-SET写操作判断步骤为判断相变存储器中当前写请求采用的写脉冲类型为SET或Partial-SET脉冲...
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- 文献传递
- 一种内存访问的方法、设备及系统
- 本发明实施例提供一种内存访问的方法、设备及系统，提供层次化的，灵活的内存靠性级别的设定方法，实现不同运行对象类型、不同可靠性级别的内存访问机制。本发明实施例提供的方法包括：内存设备接收处理器发送的所述处理器的运行对象的可...
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- 文献传递
- 一种相变存储器写加速方法及其系统
- 本发明公开了一种相变存储器写加速方法，该方法包括：Partial‑SET写操作判断步骤和写请求执行步骤，Partial‑SET写操作判断步骤为判断相变存储器中当前写请求采用的写脉冲类型为SET或Partial‑SET脉冲...
- 李冰胡瑜单书畅李晓维
- 文献传递
- 基于数据预取的多核处理器末级缓存优化方法
- 末级缓存的性能已成为影响多核处理器整体性能的关键因素.基于多核处理器在处理并行程序时各处理器核访存行为的相似性，提出一种降低访存缺失率的数据预取方法.首先记录各处理器核的访存缺失历史;然后通过分析历史信息预测各处理器核之...
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- 关键词：计算机结构多核处理器
- 基于PCM的GPU存储系统设计与优化
- 2013年
- 以相变存储器(PCM)为代表的新型非易失存储器,具有存储密度高和静态功耗低等传统动态随机存取存储器(DRAM)不具备的优势,但是过长的写操作延时会严重影响访存的性能。设计了基于PCM的图形处理器(GPU)中的存储系统。仿真结果显示,GPU程序中的内存写请求分布极不均匀,对少量的内存地址有非常高的访问频率。面向访存分布不均匀特点的专用缓冲单元设计,能够有效地存储频繁访问的内存数据,从而减少对PCM的访问次数,消除过长的写操作延时对系统性能的负面影响。GPU仿真器上的结果显示,基于缓冲单元的PCM存储系统能够有效地提高GPU的运算性能。
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- 关键词：相变存储器图形处理器
- 多核处理器的核级冗余容错技术
- 随着半导体工艺技术的不断进步,单个芯片上可集成的处理器核越来越多,处理器技术正逐步进入多核时代.然而,晶体管特征尺寸的不断减小以及阈值电压的不断降低,使得处理器的可靠性问题也日益严重.在多核环境中,如何有效地利用片上丰富...
- 单书畅胡瑜李晓维
- 关键词：多核处理器可靠性容错设计
- 文献传递
