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乔长阁
乔长阁
作品数:
23
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清华大学计算机科学与技术系
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洪先龙
清华大学计算机科学与技术系
蔡懿慈
清华大学信息科学技术学院计算机...
高德远
西北工业大学
冯闻铮
清华大学信息科学技术学院计算机...
张明德
清华大学信息科学技术学院计算机...
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离散时间细胞神经网络的学习算法
1996年
细胞神经网络的应用主要取决于其模板的设计.文章针对离散时间细胞神经网络(DTCNN)的应用,通过利用一个随机并行算法来优化一个目标函数,进而完成DTCNN模板的设计,为DTCNN的设计提供了理论根据。在连通片检测应用中的模拟表明了算法的有效性和正确性。
乔长阁
关键词:
神经网络
学习算法
带软模块的VLSI布图规划优化设计
被引量:2
1999年
布图规划是VLSI物理设计中最关键的步骤之一.随着超大规模集成电路规模的不断扩大以及模拟电路和数模混合电路的日益发展,布图规划在ICCAD工具中的作用显得更加重要.针对一般的具有不可二划分结构的布图规划问题,在序列对模型的基础上,利用模拟退火算法实现了一般结构的带软模块的布图规划问题的自动设计.除了芯片面积的优化外,算法还考虑了芯片的宽长比例等问题.文中对一些MCNC的标准例子进行了测试,并与其它文献中的结果进行了比较。
黄钢
洪先龙
乔长阁
蔡懿慈
关键词:
布图规划
模拟退火算法
VLSI
优化设计
集成电路
用HDL语言描述和模拟图像二值化神经网络
1995年
神经网络专用电路实现是目前神经网络实现研究的主要方向。本文基于我们所提出的数字式细胞神经网络.针对它在数字图像二值化中的应用,采用硬件描述语言对这个专用电路进行描述和模拟。在系统设计中,采用了微程序控制方法和流水线技术。仿真结果表明了硬件实现算法的正确性和可行性,同时也为神经网络的实现打下了良好的基础。
乔长阁
高德远
何海曦
关键词:
神经网络
硬件描述语言
图像二值化
一种随机并行算法及其在VLSI布图中的应用
被引量:9
1994年
在VLSI布图中,有许多可以归结为组合优化的问题,用传统方法解决这类问题时,很容易陷入局部极值.利用一种随机并行算法-Alopex算法,通过将VLSI布图中的一些问题公式化,并选择适当的退火策略和参数值来寻找一个代价函数的全局极值以得到最佳结果.通过实例进行了验证,得到了比较好的结果.
乔长阁
高德远
关键词:
组合优化
VLSI
布图
数字式细胞神经网络理论与应用研究
乔长阁
关键词:
神经网络
人工神经网络
VEAP:基于全局优化的有效VLSI布局算法
被引量:10
1997年
本文中,针对规则的VLSI设计模式(门阵列,标准单元等),我们提出一种新的非常简单有效的布局算法.该算法基于严格的数学分析,可以证明能够找到全局最优解.在实验中发现,对于很大规模的电路,我们的算法比现有的所有算法都快.此外,我们的算法还能够同时适应于线长优化和时延优化模式.
孔天明
洪先龙
乔长阁
关键词:
VLSI
全局优化
基于Sakurai模型的时延驱动Steiner树算法
被引量:3
1999年
时延驱动的Steiner树构造算法是时延驱动总体布线的基础.本文首先简介了求解最佳Steiner树的Dreyfus-Wagner算法.随后通过引入Sakurai时延模型,提出了直接基于Sakurai模型的提高线网时延性能的时延驱动DW算法.当集成电路工艺的特征宽度较小时,该算法求得的Steiner树中关键点的时延值,明显小于IDW和CFD算法的结果.
鲍海云
洪先龙
蔡懿慈
乔长阁
关键词:
IC
STEINER树
一种用于图像二值化的细胞神经网络模型
被引量:5
1995年
本文提出了一种用于图像二值化的神经网络模型,我们称它为数字式细胞神经网络。它基于蔡少堂等提出的细胞神经网络概念[1][2],但采用了神经元离散时间的数字动力学技术。利用这个模型,只要通过简单的整数运算就可以并行高速地对灰度图像进行二值化。对于不同邻接和权值的选择得到了比传统二值化方法更自然的二值图像。另外,所提出的神经网络模型非常适合于数字VLSI实现。
乔长阁
高德远
关键词:
图像二值化
细胞神经网络
图像处理
BBL模式下电源/地线拓扑结构的设计与优化
被引量:4
2000年
在超大规模集成电路的设计中 ,BBL是一种新的具有良好发展前景的布图模式 .对于这种模式下电源和地线的设计和优化 ,至今还没有很好的讨论 .本文提出了一种针对BBL模式的高效电源 /地线网络的设计与优化算法 .该算法分为三个步骤 :首先扫描出布线通道 ,然后按照几个布线原则和代价函数形成供电森林的拓扑结构 ,最后使用拉格朗日乘子法对线宽进行迭代优化以求得最小的布线面积 .实验证明 ,该算法的运算速度很快 ,而且能够大幅度降低电源和地线所占用的布线资源 ,同时耗费的内存很小 .
武晓海
乔长阁
殷莉
洪先龙
关键词:
电源
地线
拓扑结构
VLSI
一种减小关键路径延迟的回路布线法
1996年
传统的性能驱动布线算法受限于树形或固定的布线拓扑结构.本文提出一种回路性能优化布线算法,针对树形线网布线,通过在已存在的布线树上加入回路来减小所选择关键路径的延迟时间或线网的最大延迟.我们将互连线树归结为分布传输线网络并采用Elmore延迟计算方法.本文证明,通过选择适当的RC,在连接节点与关键节点之间加入连线可达到减小所选择线网中关键路径延迟或线网最大延迟的目的.实验结果表明,我们的方法有效且可以集成在现有CAD性能优化布线系统中.本文同时给出了所加入线段长度的计算方法.
乔长阁
洪先龙
关键词:
集成电路
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