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CABAC二值化建模器的硬件优化设计: 2013年; 提出一种二值化建模器的语法元素拆分合并策略及对应的硬件结构,能够使二元位串长度的分布更集中更平坦,从而提高了H.264/AVC中基于上下文的自适应二进制算术编码器(CABAC)的吞吐率和硬件资源利用率。本文使用生产者/消费者模型为CABAC编码器建模进行数据统计和分析,发现通过合并特定语法元素使二元位串平均长度增加可以提高CABAC编码器的吞吐率,而通过分割特定语法元素使二元位串长度的峰值更小变化更均匀可以增加硬件资源的利用率。仿真结果显示该设计平均每节拍能够处理1.89个二元位,该设计在0.13μm CMOS工艺下综合工作频率可达303MHz,相应资源占用为22.26K门。; 彭斌丁丹丹虞露; 关键词：视频编码 H CABAC 硬件结构设计

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彭斌